(no commit message)
authorlkcl <lkcl@web>
Fri, 8 May 2020 11:01:12 +0000 (12:01 +0100)
committerIkiWiki <ikiwiki.info>
Fri, 8 May 2020 11:01:12 +0000 (12:01 +0100)
180nm_Oct2020.mdwn

index 31c187a0a4fe76a6a611968e0fc142f159b90f33..27417ece899f278fc312d381a2bc65cc942144e7 100644 (file)
@@ -19,7 +19,7 @@ To be expanded with links to bugreports
 * a very very basic Common Data Bus infrastructure.
 * a TLB and MMU are not strictly essential (not for a proof-of-concept ASIC)
 * neither in some ways is a L1 cache
-* interfaces we need as a bare minimum include GPIO, EINT, SPI and QSPI,
+* [[180nm_oct2020/interfaces]] we need as a bare minimum include GPIO, EINT, SPI and QSPI,
   I2C, UART16550, LPC (from Raptor Engineering) and that actually might
   even be it.