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[riscv-isa-sim.git] / riscv / insns / fmax_s.h
index 215a6d14565410fd347a2350fc7624a156f6470b..33b2bc618f602525e1c5686996e01cdbdea6cba2 100644 (file)
@@ -1,5 +1,4 @@
 require_extension('F');
 require_fp;
-WRITE_FRD(isNaNF32UI(FRS2) || f32_le_quiet(FRS2,FRS1) /* && FRS1 not NaN */
-      ? FRS1 : FRS2);
+WRITE_FRD(isNaNF32UI(FRS2) || f32_le_quiet(f32(FRS2), f32(FRS1)) ? FRS1 : FRS2);
 set_fp_exceptions;