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[riscv-isa-sim.git] / riscv / insns / fmin_d.h
index 02ea6810d34f64063f8e9cac94e74af152839807..e22b6eaf42dbaf367325d39eb06340a446c3b446 100644 (file)
@@ -1,5 +1,4 @@
 require_extension('D');
 require_fp;
-WRITE_FRD(isNaNF64UI(FRS2) || f64_lt_quiet(FRS1,FRS2) /* && FRS1 not NaN */
-      ? FRS1 : FRS2);
+WRITE_FRD(isNaNF64UI(FRS2) || f64_lt_quiet(f64(FRS1), f64(FRS2)) ? FRS1 : FRS2);
 set_fp_exceptions;